聯發科AI團隊徵IC設計好手
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基本需求：當然是要會寫Verilog啦~
加分項：熟AI算法、AXI/APB Bus、CPU/GPU/RISCV/DSP 架構、Cache
design、OpenCL、Perl、C、FPGA
就算是加分項一個都沒有，還有超級加分項也可。
超級加分項：有一顆進取的心，精益求精的心，和不怕困難的心。
待遇：年薪200+ (新聞
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歡迎同學(今年已畢業，快畢業，明年畢業的碩博生皆可)來丟履歷
有興趣的人請將履歷寄給：cs.chou@mediatek.c